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CADENCE C-TO-SILICON COMPILER高層次綜合(中文)

內(nèi)容簡介

      Cadence C-to-Silicon Compiler會從定時(shí)與非定時(shí)的C/C++/SystemC算法描述為數(shù)據(jù)路徑與控制功能性電路自動生成可綜合的RTL。讓得到的代碼質(zhì)量達(dá)到或超過手工編寫的RTL設(shè)計(jì)的90%，同時(shí)讓
工程師投入的精力減少達(dá)90%，C-to-Silicon Compiler成為RTL代碼生成的設(shè)計(jì)復(fù)雜性與效率之間銜接的橋梁。

下載說明
發(fā)布公司：Cadence
更新時(shí)間：2009-07-29		 文件大?。?56.95 Kb
下載次數(shù)： 138
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