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引腳名稱	引腳功能說明
VCC	數字電路的電源。
GND	地。
端口A(PA7..PA0)	端口A 為8 位雙向I/O 口，并具有可編程的內部上拉電阻。其輸出緩沖器具有對稱的驅動特性，可以輸出和吸收大電流。作為輸入使用時，若內部上拉電阻使能，則端口被外部電路拉低時將輸出電流。復位發生時端口A 為三態。端口A 也可以用做其他不同的特殊功能，請參見P 68。
端口B(PB7..PB0)	端口B 為8 位雙向I/O 口，并具有可編程的內部上拉電阻。其輸出緩沖器具有對稱的驅動特性，可以輸出和吸收大電流。作為輸入使用時，若內部上拉電阻使能，則端口被外部電路拉低時將輸出電流。復位發生時端口B 為三態。端口B 也可以用做其他不同的特殊功能，請參見P 69。
端口C(PC7..PC0)	端口C 為8 位雙向I/O 口，并具有可編程的內部上拉電阻。其輸出緩沖器具有對稱的驅動特性，可以輸出和吸收大電流。作為輸入使用時，若內部上拉電阻使能，則端口被外部電路拉低時將輸出電流。復位發生時端口C 為三態。端口C 也可以用做其他不同的特殊功能，請參見 P 72。在ATmega103 兼容模式下，端口C 只能作為輸出，而且在復位發生時不是三態。
端口D(PD7..PD0)	端口D 為8 位雙向I/O 口，并具有可編程的內部上拉電阻。其輸出緩沖器具有對稱的驅動特性，可以輸出和吸收大電流。作為輸入使用時，若內部上拉電阻使能，則端口被外部電路拉低時將輸出電流。復位發生時端口D 為三態。端口D 也可以用做其他不同的特殊功能，請參見P 73。
端口E(PE7..PE0)	端口E 為8 位雙向I/O 口，并具有可編程的內部上拉電阻。其輸出緩沖器具有對稱的驅動特性，可以輸出和吸收大電流。作為輸入使用時，若內部上拉電阻使能，則端口被外部電路拉低時將輸出電流。復位發生時端口E 為三態。端口E 也可以用做其他不同的特殊功能，請參見P 75。
端口F(PF7..PF0)	端口 F 為ADC 的模擬輸入引腳。如果不作為ADC 的模擬輸入，端口 F 可以作為8 位雙向I/O 口，并具有可編程的內部上拉電阻。其輸出緩沖器具有對稱的驅動特性，可以輸出和吸收大電流。作為輸入使用時，若內部上拉電阻使能，則端口被外部電路拉低時將輸出電流。復位發生時端口 F 為三態。如果使能了JTAG 接口，則復位發生時引腳PF7(TDI)、PF5(TMS) 和PF4(TCK) 的上拉電阻使能。端口 F 也可以作為JTAG 接口。在ATmega103 兼容模式下，端口F 只能作為輸入引腳。
端口G(PG4..PG0)	端口G 為5 位雙向I/O 口，并具有可編程的內部上拉電阻。其輸出緩沖器具有對稱的驅動特性，可以輸出和吸收大電流。作為輸入使用時，若內部上拉電阻使能，則端口被外部電路拉低時將輸出電流。復位發生時端口G 為三態。端口G 也可以用做其他不同的特殊功能。在ATmega103 兼容模式下，端口G 只能作為外部存儲器的所存信號以及32 kHz 振蕩器的輸入，并且在復位時這些引腳初始化為PG0 = 1， PG1 = 1 以及PG2 = 0。PG3 和 PG4 是振蕩器引腳。
RESET	復位輸入引腳。超過最小門限時間的低電平將引起系統復位。門限時間在P 47Table 19 說明。低于此時間的脈沖不能保證可靠復位。
XTAL1	反向振蕩器放大器及片內時鐘操作電路的輸入。
XTAL2	反向振蕩器放大器的輸出。
AVCC	AVCC為端口F以及ADC轉換器的電源，需要與VCC相連接，即使沒有使用ADC也應該如此。使用ADC 時應該通過一個低通濾波器與VCC 連接。
AREF	AREF 為ADC 的模擬基準輸入引腳。
PEN	PEN是SPI串行下載的使能引腳。在上電復位時保持PEN為低電平將使器件進入SPI串行下載模式。在正常工作過程中PEN 引腳沒有其他功能。

關鍵字：ATmega128 引腳功能微處理器引用地址：ATmega128 引腳功能

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