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*將ACLK和SMCLK配置為REFCLK、VLOCLK

#include <msp430.h> /**
 * main.c
 */int main(void){
	WDTCTL = WDTPW | WDTHOLD;	// stop watchdog timer
	P1DIR |= BIT0;      //設置為輸出
	P1SEL |= BIT0;      //ACLK輸出端，用來測量頻率
	P2DIR |= BIT2;
	P2SEL |= BIT2;      //SMCLK
    P7DIR |= BIT7;
    P7SEL |= BIT7;      //MCLK

    UCSCTL4 = UCSCTL4&(~(SELS_7|SELM_7)) | SELS_2 | SELA_1;
    //USCTL4&(~(SELS_7|SELM_7))表示將SELS和SELM清零
    while(1);
	return 0;}1234567891011121314151617181920

上圖
33KHZ
33.086KHZ，很接近REFO=32.768KHZ
在這里插入圖片描述
9.4013KHZ，也很接近VLO=10KHZ

關鍵字：MSP430F5529 ACLK SMCLK 引用地址：MSP430F5529 上手小例程4

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