LF mode (XTS = 0) 

HF mode (XTS = 1)

控制位OSCOFF,XT2OFF分別用于控制是否禁止使用LFXT1和XT2晶振 

OSCOFF,XT2OFF=1表示禁止

SMCLK 和 MCLK 時鐘信號時，可以用控制位 SCG0 禁止直流發(fā)生器。

在 PUC 信號之后，DCOCLK 被自動選作 MCLK 時鐘信號，根據需要，MCLK 的時鐘源可以另外設置為 

LFXT1 或者 XT2。設置順序如下： 

(1)讓 OSCOFF=1 

(2)讓 OFIFG=0 

(3)延時等待至少 50us 

(4)再次檢查 OFIFG，如果 OFIFG=1，重復(3)、(4)步驟，直到 OFIFG＝0 為止。

MSP430F169 單片機的基本時鐘系統(tǒng)寄存器

DCOCTL

DCOx： DCO 頻率選擇 

用來選擇 8 種頻率，可分段進行調節(jié) DCOCLK 頻率。該頻率是建立在 RSELx 選定的頻段上。 

MODx：DAC 調制器設定 

控制切換 DCOx 和 DCOx+1 選擇的兩種頻率，來微調 DCO 的輸出頻率。 

如果 DCOx 常數是 7，表示已經選擇最高頻率，此時 MODx 失效，不能用來進行頻率調整。

BCSCTL1

XT2OFF：XT2 高速晶振控制 

此位用于控制 XT2 振蕩器的開啟與關閉。 

0： XT2 高速晶振開 

1： XT2 高速晶振關 

XTS：LFXT1 高速/低速模式選擇 

0： LFXT1 工作在低速晶振模式（默認） 

1： LFXT1 工作在高速晶振模式 

DIVAx：ACLK 分頻選擇 

0： 不分頻 

1： 2 分頻 

2： 4 分頻 

3： 8 分頻 

XT5V：不使用 

通常此位復位 XT5V=0 

RSELx：DCO 震蕩器的頻段選擇 

該 3 位控制某個內部電阻以決定標稱頻率。 

0： 選擇最低的標稱頻率 

…… 

7： 選擇最高的標稱頻率

BCSCTL2

SELMx：選擇 MCLK 時鐘源 

0： MCLK 時鐘源為 DCOCLK（默認） 

1： MCLK 時鐘源為 DCOCLK 

2： MCLK 時鐘源為 XT2CLK 

3： MCLK 時鐘源為 LFXT1CLK 

DIVMx：選擇 MCLK 分頻 

0： 不分頻（默認） 

1： 2 分頻 

2： 4 分頻 

3： 8 分頻 

SELS：選擇 SMCLK 時鐘源 

0： SMCLK 時鐘源為 DCOCLK（默認） 

1： SMCLK 時鐘源為 XT2CLK 

DIVSx：選擇 SMCLK 分頻 

0： 不分頻（默認） 

1： 2 分頻 

2： 4 分頻 

3： 8 分頻 

DCOR：選擇 DCO 震蕩電阻 

0： 內部電阻 

1： 外部電阻

基本時鐘系統(tǒng)頭文件定義

/************************************************************ 

* Basic Clock Module 

************************************************************/ 

#define DCOCTL_  (0x0056) /* DCOCTL 的定義 */

DEFC( DCOCTL , DCOCTL_) 

#define BCSCTL1_  (0x0057) /* BCSCTL1 的定義 */ 

DEFC( BCSCTL1 , BCSCTL1_) 

#define BCSCTL2_  (0x0058) /* BCSCTL2 的定義 */

DEFC( BCSCTL2 , BCSCTL2_)

/* DCOCTL 的位定義 */ 

#define MOD0 (0x01) /* Modulation Bit 0 */

#define MOD1 (0x02) /* Modulation Bit 1 */

#define MOD2 (0x04) /* Modulation Bit 2 */

#define MOD3 (0x08) /* Modulation Bit 3 */

#define MOD4 (0x10) /* Modulation Bit 4 */

#define DCO0 (0x20) /* DCO Select Bit 0 */

#define DCO1 (0x40) /* DCO Select Bit 1 */

#define DCO2 (0x80) /* DCO Select Bit 2 */

/* BCSCTL1 的位定義 */ 

#define RSEL0 (0x01) /* Resistor Select Bit 0 */

#define RSEL1 (0x02) /* Resistor Select Bit 1 */

#define RSEL2 (0x04) /* Resistor Select Bit 2 */

#define XT5V (0x08) /* XT5V should always be reset */

#define DIVA0 (0x10) /* ACLK Divider 0 */

#define DIVA1 (0x20) /* ACLK Divider 1 */

#define XTS (0x40) /* LFXTCLK 0:Low Freq. / 1: High Freq. */

#define XT2OFF (0x80) /* Enable XT2CLK */

/* BCSCTL1 的 DIVA 的功能定義 */ 

#define DIVA_0 (0x00) /* ACLK Divider 0: /1 */

#define DIVA_1 (0x10) /* ACLK Divider 1: /2 */

#define DIVA_2 (0x20) /* ACLK Divider 2: /4 */

#define DIVA_3 (0x30) /* ACLK Divider 3: /8 */

/* BCSCTL2 的位定義 */ 

#define DCOR (0x01) /* Enable External Resistor : 1 */

#define DIVS0 (0x02) /* SMCLK Divider 0 */

#define DIVS1 (0x04) /* SMCLK Divider 1 */

#define SELS (0x08) /* SMCLK Source Select 0:DCOCLK / 1:XT2CLK/LFXTCLK 

#define DIVM0 (0x10) /* MCLK Divider 0 */

#define DIVM1 (0x20) /* MCLK Divider 1 */

#define SELM0 (0x40) /* MCLK Source Select 0 */

#define SELM1 (0x80) /* MCLK Source Select 1 */

/* BCSCTL1 的 DIVS 的功能定義 */

#define DIVS_0 (0x00) /* SMCLK Divider 0: /1 */

#define DIVS_1 (0x02) /* SMCLK Divider 1: /2 */

#define DIVS_2 (0x04) /* SMCLK Divider 2: /4 */

#define DIVS_3 (0x06) /* SMCLK Divider 3: /8 */

/* BCSCTL1 的 DIVM 的功能定義 */

#define DIVM_0 (0x00) /* MCLK Divider 0: /1 */

#define DIVM_1 (0x10) /* MCLK Divider 1: /2 */

#define DIVM_2 (0x20) /* MCLK Divider 2: /4 */

#define DIVM_3 (0x30) /* MCLK Divider 3: /8 */

/* BCSCTL1 的 SELM 的功能定義 */

#define SELM_0 (0x00)

/* MCLK Source Select 0: DCOCLK */

#define SELM_1 (0x40) /* MCLK Source Select 1: DCOCLK */

#define SELM_2 (0x80) /* MCLK Source Select 2: XT2CLK/LFXTCLK */

#define SELM_3 (0xC0) /* MCLK Source Select 3: LFXTCLK