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2020年02月13日 | 關(guān)于時(shí)鐘恢復(fù)基礎(chǔ)知識的分享和應(yīng)用

發(fā)布者:yunhui 來源: elecfans關(guān)鍵字:時(shí)鐘恢復(fù)  基礎(chǔ)知識  示波器 手機(jī)看文章 掃描二維碼
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這期我會講解在抖動、眼圖測試中非常重要的時(shí)鐘恢復(fù)相關(guān)知識。這部分的內(nèi)容分為兩部分,今天會通過PPT給大家講解時(shí)鐘恢復(fù)的基礎(chǔ)概念,圖文二利用我們的10bit S系列示波器和演示版給大家做實(shí)際演示,讓大家有一個(gè)非常直觀的認(rèn)識。

關(guān)于時(shí)鐘恢復(fù)基礎(chǔ)知識的分享和應(yīng)用

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所以從測試測量角度講,為了讓我們的結(jié)果有更好的工程意義和參考意義,在進(jìn)行抖動/眼圖模板測試、串行協(xié)議解碼和串型數(shù)據(jù)碼型觸發(fā)等分析時(shí),需要設(shè)定合適的時(shí)鐘恢復(fù)。

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在示波器里面,我們常用的時(shí)鐘恢復(fù)方法都是通過軟件來實(shí)現(xiàn)的,也就是捕獲一屏數(shù)據(jù),然后通過軟件的方式,從數(shù)據(jù)里面提取時(shí)鐘。示波器最常用的時(shí)鐘恢復(fù)方法有以下四種:常頻方式、PLL鎖相環(huán)、外時(shí)鐘恢復(fù)和特殊方式。

?  第一種方式,是常頻或者定頻的方式,也就是從軟件中提取一個(gè)非常純的時(shí)鐘。這種方式可以得到被測信號在所有頻率上的所有抖動成分。

?  另外一種方式,是PLL鎖相環(huán)的方式,這種方式是模擬接收端硬件PLL鎖相環(huán)恢復(fù)電路,分析得到的抖動成分,它是工程上最常使用的一種時(shí)鐘恢復(fù)方式。

?  第三種是采用外部時(shí)鐘恢復(fù),這種方式用于有一個(gè)顯性時(shí)鐘信號或者forwarded reference clock的串行信號,比如LVDS,HDMI,Intel QPI總線等。

?  最后一種就是特殊的時(shí)鐘恢復(fù)方式,按照信號協(xié)議規(guī)范的要求采用特定的時(shí)鐘恢復(fù)方法,比如PCIE信號,它采用的就是協(xié)會指定的Sigtest軟件進(jìn)行時(shí)鐘恢復(fù)。

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對于常用的硬件PLL鎖相環(huán)時(shí)鐘恢復(fù)電路,我們在學(xué)校自控理論課程里面都學(xué)習(xí)過。首先會基于設(shè)定,壓控振蕩器VCO會產(chǎn)生一個(gè)起振時(shí)鐘,它的時(shí)鐘邊沿和輸入信號的邊沿/相位通過鑒相器進(jìn)行比對,鑒相器會產(chǎn)生一個(gè)和相位差等比例的電壓信號。這個(gè)電壓信號經(jīng)過PLL環(huán)路濾波器的調(diào)理后會再送到VCO電路,改變恢復(fù)時(shí)鐘的相位,通過負(fù)反饋電路最終提取出用于串行數(shù)據(jù)bit切割的時(shí)鐘。其中,環(huán)路濾波器會對輸入的電壓信號進(jìn)行低通濾波,從而限制了PLL鎖相環(huán)電路恢復(fù)時(shí)鐘的帶寬。

如果提取的時(shí)鐘比較干凈,那么通過時(shí)鐘恢復(fù)電路后的數(shù)據(jù)就含有比較大的抖動:反之,如果提取的時(shí)鐘含有比較大的抖動,那么最終得到的數(shù)據(jù)就比較干凈。這就是時(shí)鐘恢復(fù)電路的一個(gè)很大的優(yōu)勢,它通過恢復(fù)的時(shí)鐘可以追蹤數(shù)字電路中肯定存在的低頻抖動,比如工頻電、開關(guān)電源等,從而提高電路的抗干擾性。

工業(yè)領(lǐng)域,我們通常用抖動傳遞函數(shù)JTF(Jitter Transfer Function)或者是觀察到的抖動傳遞函數(shù)OJTF(Observed Jitter Transfer Function)來描述硬件PLL鎖相環(huán)時(shí)鐘恢復(fù)電路。

JTF如上圖藍(lán)色曲線所示,它表征輸入信號所包含的抖動有多少會傳遞到輸出的恢復(fù)時(shí)鐘上,這是一個(gè)低通濾波器特性;

OJTF如上圖粉色曲線所示,它表征接收端所觀察到的抖動大小,反映的是有多少高頻抖動成分傳遞到接收端,表現(xiàn)出的是高通濾波器特性。JTF和OJTF在S域里面之和等于一。

時(shí)鐘恢復(fù)環(huán)路的定義有一階和二階之分,一階主要是帶寬這個(gè)指標(biāo);二階除了帶寬指標(biāo)外還包含峰值和阻尼因子。對于JTF和OJTF,不同的協(xié)會有不同采用。比如,USB,PCIE采用JTF來定義時(shí)鐘恢復(fù)環(huán)路;SATA用OJTF來定義時(shí)鐘恢復(fù)環(huán)路。

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對于PLL鎖相環(huán)帶寬的設(shè)定建議如上圖所示,優(yōu)先級由上到下。最準(zhǔn)確定義是按照各總線規(guī)范的要求,比如USB、SATA、PCIE等;或者按照接收端的硬件參數(shù)設(shè)定。如果兩者都不太清楚,可以采用Golden鎖相環(huán),信號速率4Gbps以下,PLL鎖相環(huán)帶寬是信號速率除以1667,4G以上,PLL鎖相環(huán)帶寬是信號速率除以2500。需要注意的是,為了讓你的測試具有工程參考意義,不同的數(shù)據(jù)速率應(yīng)該對應(yīng)不同的PLL鎖相環(huán)帶寬設(shè)定。

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上圖是一個(gè)例子,對于相同的一個(gè)信號,當(dāng)使用不同的PLL帶寬設(shè)定時(shí),會得到不同的抖動和眼圖結(jié)果。如左上圖,當(dāng)采用8MHz這個(gè)比較大的帶寬時(shí),你得到的眼圖結(jié)果會比較漂亮;但是,如右上圖,當(dāng)采用50KHz較窄的帶寬設(shè)定時(shí),眼圖結(jié)果就比較糟糕,這是因?yàn)槲覀冇^察到了50KHz~8MHz以內(nèi)抖動成分對信號的影響。


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